印制電路板特性阻抗的控制_高都電子PCB技術(shù)中心_pcb學(xué)院P

一種好的疊層結(jié)構(gòu)就能夠作到對(duì)印制電路板特性阻抗的控制，其走線可形成易控制和可預(yù)測(cè)的傳輸線結(jié)構(gòu)。

一、印制電路板特征阻抗
       根據(jù)傳輸線理論和信號(hào)的傳輸理論，信號(hào)不僅僅是時(shí)間變量的函數(shù)，同時(shí)還是距離變量的函數(shù)，所以信號(hào)在連線上的每一點(diǎn)都有可能變化。因此定義連線的交流阻抗，即變化的電壓和變化的電流之比為傳輸線的特性阻抗（Characteristic Impedance）：

傳輸線的特性阻抗只與信號(hào)連線本身的特性相關(guān)。在實(shí)際電路中，導(dǎo)線本身電阻值小于系統(tǒng)的分布阻抗，特別是在高頻電路中，特性阻抗主要取決于連線的單位分布電容和單位分布電感帶來(lái)的分布阻抗。理想傳輸線的特性阻抗只取決于連線的單位分布電容和單位分布電感。

二、印制電路板特性阻抗的計(jì)算
       信號(hào)的上升沿時(shí)間和信號(hào)傳輸?shù)浇邮斩怂钑r(shí)間的比例關(guān)系，決定了信號(hào)連線是否被看作是傳輸線。具體的比例關(guān)系由下面的公式可以說(shuō)明：

 如果PCB板上導(dǎo)線連線長(zhǎng)度大于l/b就可以將信號(hào)之間的連接導(dǎo)線看作是傳輸線。由信號(hào)等效阻抗計(jì)算公式可知，傳輸線的阻抗可以用下面的公式表示：

在高頻（幾十兆赫到幾百兆赫）情況下滿足wL>>R（當(dāng)然在信號(hào)頻率大于10 9Hz的范圍內(nèi)，則考慮到信號(hào)的集膚效應(yīng)，需要仔細(xì)地研究這種關(guān)系）。那么式（2-3）可以簡(jiǎn)化為式（2-1）所示.

那么對(duì)于確定的傳輸線而言，其特性阻抗為一個(gè)常數(shù)。信號(hào)的反射現(xiàn)象就是因?yàn)樾盘?hào)的驅(qū)動(dòng)端和傳輸線的特性阻抗以及接收端的阻抗不一致所造成的。對(duì)于CMOS電路而言，信號(hào)的驅(qū)動(dòng)端的輸出阻抗比較小，為幾十歐。而接收端的輸入阻抗就比較大。

三、印制電路板特性阻抗控制
       印制電路板上導(dǎo)線的特性阻抗是電路設(shè)計(jì)的一個(gè)重要指標(biāo)，特別是在高頻電路的PCB設(shè)計(jì)中，必須考慮導(dǎo)線的特性阻抗和器件或信號(hào)所要求的特性阻抗是否一致，是否匹配。因此，在PCB設(shè)計(jì)的可靠性設(shè)計(jì)中有兩個(gè)概念是必須注意的。

1 印制電路板阻抗控制
       線路板中的導(dǎo)體中會(huì)有各種信號(hào)傳遞，當(dāng)為提高其傳輸速率而必須提高其頻率，線路本身若因蝕刻、疊層厚度、導(dǎo)線寬度等因素不同，將會(huì)造成阻抗值得變化，使其信號(hào)失真。故在高速線路板上的導(dǎo)體，其阻抗值應(yīng)控制在某一范圍之內(nèi)，稱為“阻抗控制”。

影響PCB走線的阻抗的因素主要有銅線的寬度、銅線的厚度、介質(zhì)的介電常數(shù)、介質(zhì)的厚度、焊盤(pán)的厚度、地線的路徑、走線周邊的走線等。所以在設(shè)計(jì)PCB時(shí)一定要對(duì)板上走線的阻抗進(jìn)行控制，才能盡可能避免信號(hào)的反射以及其他電磁干擾和信號(hào)完整性問(wèn)題，保證PCB板的實(shí)際使用的穩(wěn)定性。

PCB板上微帶線和帶狀線阻抗的計(jì)算方法可參照相應(yīng)的經(jīng)驗(yàn)公式。
     （1）微帶線。
       PCB板上微帶線阻抗的計(jì)算方法可參照下式：

H為兩參考平面的距離，并且走線位于兩參考平面的中間。此公式必須W/H<0.35及T/H<0.25的情況才能應(yīng)用。

（2-4）和式（2-5）兩個(gè)公式只是經(jīng)驗(yàn)公式，如果要得到比較準(zhǔn)確的結(jié)果，最好還是用仿真軟件來(lái)計(jì)算。其他導(dǎo)線的阻抗可以根據(jù)PCB設(shè)計(jì)特性阻抗來(lái)計(jì)算。

2 印制電路板阻抗匹配
       在線路板中，若有信號(hào)傳送時(shí)，希望由電源的發(fā)出端起，在能量損失最小的情形下，能順利的傳送到接受端，而且接受端將其完全吸收而不作任何反射。要達(dá)到這種傳輸，線路中的阻抗必須和發(fā)出端內(nèi)部的阻抗相等才行稱為“阻抗匹配”。

在設(shè)計(jì)高速PCB電路時(shí)，阻抗匹配是設(shè)計(jì)的要素之一。而阻抗值與走線方式有絕對(duì)的關(guān)系。例如，是走在表面層（Microstrip）還是內(nèi)層（Stripline/Double Stripline）、與參考的電源層或地層的距離、走線寬度、PCB材質(zhì)等均會(huì)影響走線的特性阻抗值。也就是說(shuō)，要在布線后才能確定阻抗值，同時(shí)不同PCB生產(chǎn)廠家生產(chǎn)出來(lái)的特性阻抗也有微小的差別。

一般仿真軟件會(huì)因線路模型或所使用的數(shù)學(xué)算法的限制而無(wú)法考慮到一些阻抗不連續(xù)的布線情況，這時(shí)候在原理圖上只能預(yù)留一些端接（Temninators），如串聯(lián)電阻等，來(lái)緩和走線阻抗不連續(xù)的效應(yīng)。真正根本解決問(wèn)題的方法還是布線時(shí)盡量注意避免阻抗不連續(xù)的發(fā)生。